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飛思卡爾半導體推出QorIQ P4080多核處理器，一個旨在為嵌入式多核空間中的性能、功效和編程性設定新標準的非常先進的八核通信處理器。P4080多核處理器是飛思卡爾新QorIQ平臺的標志性成員，基于45 nm處理技術。它集成了增強的PowerArchitecture內核、三級緩存分層、創(chuàng)新CoreNet片上結構和數據路徑加速，可在最大30W的功率電路內提供卓著性能。
QorIQ P4080能夠并行處理控制平面、數據平面和應用層的處理任務，它非常適合于聯(lián)網、電信、工業(yè)、軍事和航天領域的一些應用，如交換機、企業(yè)和服務提供商路由器、接入和媒體網關、基站控制器、無線網絡控制器(RNC)和通用嵌入式計算系統(tǒng)。
實現(xiàn)卓越性能的架構要點
P4080 SoC內置8個增強型Power Architecturee500mc內核，目標直指1．5 GHz的最高頻率。每個內核都有其自己的專用128 KB L2后端緩存，并能夠接入2 MB共享前端L3緩存。完全的處理器獨立性(包括啟動和重置各單個e500mc內核的能力)是該器件最顯著的特征。內核可以作為8個對稱多處理(SMP)內核或8個完全不對稱多處理(AMP)內核，也可以SMP和AMP組的組合且以不同程度的獨立性進行運行。此外，內核還能夠運行不同操作系統(tǒng)(0S)或者在無0S情況下運行，為用戶提供了在控制、數據路徑和應用處理間進行分區(qū)的極大靈活性。
整體性能通過數據路徑加速架構(DPAA)得以增強，而DPAA同時又提供高聯(lián)網性能，降低了軟件復雜性。該加速架構與內核一起，管理分組路由、安全、服務質量和深度分組檢測，讓內核把注意力集中到增值服務和應用處理上來。由于消除了其他多核方法中常見的一些與共享總線／共享存儲器架構有關的總線爭奪、瓶頸和延遲問題，CoreNet結構因此也提高了性能。
QorIQ P4080內置各種令人印象深刻的高速I／0技術，包括2個10 Gbps以太網(XAUI)控制器、8個1 Gbps以太網(SGMII)控制器、3個運行在最高5 GHz頻率上的PCI Express v2．O控制器／端口、2個運行在最高3．125GHz頻率上的串行RapidIO 1．2控制器／端口。
面向下一代通信的QorIQ多核平臺
飛思卡爾半導體全新的通信平臺QorIQ，旨在實現(xiàn)下一代聯(lián)網，把嵌入式多核的應用提高到一個新水平。新QorIQ平臺是飛思卡爾PowerQUICC處理器的下一代產品，可以讓開發(fā)人員自信地移植到多核。
多核是一項異常復雜的技術，對功率、成本和性能要求都受到嚴格限制的嵌入式領域來說尤其如此。實現(xiàn)多核需要的不僅僅是先進的硅，還要求深入、系統(tǒng)地了解內核、操作系統(tǒng)和軟件是如何在一起工作的�，F(xiàn)在有了QorIQ，嵌入式行業(yè)就有了第二代嵌入式多核，以及一個來自飛思卡爾的可靠合作伙伴的連貫的多核移植解決方案。
QorIQ平臺有單核、雙核和多核處理器，它們全部基于飛思卡爾的e500 Power Architecture技術。平臺從P1和P2開始，它們由5個封裝、引腳和軟件兼容的處理器組成，以簡化從單核到雙核處理的過渡。P3和P4平臺使開發(fā)人員能夠遷移到“多核”領域，滿足更高級的處理需求。P5平臺是嵌入式功率預算范圍內性能最高的飛思卡爾解決方案。所有這些QorIQ平臺都配有廣泛的編程支持，以幫助開發(fā)人員最大限度地利用他們的多核實施。
出色的性能和可編程能力
飛思卡爾的QorIQ平臺統(tǒng)一使用高性能e500 PowerArchitecture內核，這些內核的頻率范圍從400MHz到1．5 GH不等。QorIQ系列的高端產品還具有進一步提升性能的突破性嵌入式處理創(chuàng)新，包括每個內核的專屬后端緩存、數據路徑加速架構(DPAA)和CoreNet相干性構造。
QorIQ平臺最低為45nm量級，并提供了一個32 nm(及以上)路線圖。與其他嵌入式多核架構相比，基于QorIQ技術的產品功耗要低得多。45nm節(jié)點上提供的QorIQ產品包括的解決方案，其范圍從4W上高度集成的產品到30W以下的“多核”器件。QorIQ P3和P4平臺允許系統(tǒng)開發(fā)人員嚴格管理器件頻率和電壓。